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@karaketir16

karaketir16/0_SimpleCPU.md

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Raw
0_SimpleCPU.md

Simple CPU Instruction Set

Overview

  • 12-bit registers: R0--R7 (3-bit register indices).
  • R0 is hardwired to zero.
  • All instructions are 16 bits.
  • Instruction groups by opcode patterns:
    • 0000 (0x0): Arithmetic & Shift Instructions (with funct field)
    • 0001 (0x1): Logical Instructions (with funct field)
    • 0010 (0x2): Load Immediate Low
    • 0011 (0x3): Load Immediate Upper
    • 0100–1000 (0x4–0x8): Branch Instructions
    • 1001 (0x9): Jump Instructions
    • 1010 (0xA): Jump Register
    • 1011 (0xB): Load Word
    • 1100 (0xC): Store Word
    • 1101–1111 (0xD–0xF): Reserved for future extensions

Opcodes and Functions

0000 (0x0): Arithmetic & Instructions

funct Mnemonic Description
000 ADD rd,rs,rt rd = rs + rt
001 SUB rd,rs,rt rd = rs - rt
010 AND rd,rs,rt rd = rs & rt
011 OR rd,rs,rt `rd = rs
100 XOR rd,rs,rt rd = rs ^ rt
101 SRA rd,rs,rt rd = rs >> rt (arith)
110 SLL rd,rs,rt rd = rs << rt
111 SRL rd,rs,rt rd = rs >> rt (logical)

0001 (0x1): Future use

0010 (0x2): Load Immediate Low

Mnemonic Description
LIL rd, imm rd = imm (9-bit lower immediate)

0011 (0x3): Load Immediate Upper

Mnemonic Description
LIU rd, imm rd = imm << 3 (shifted upper immediate)

0100–1000 (0x4–0x8): Branch Instructions

Mnemonic Opcode (hex) Description
BEQ rs,rt,off 0x4 if (rs == rt) PC += off
BLTU rs,rt,off 0x5 if (rs < rt) unsigned PC += off
BLTS rs,rt,off 0x6 if (rs < rt) signed PC += off
BLTEU rs,rt,off 0x7 if (rs <= rt) unsigned PC += off
BLTES rs,rt,off 0x8 if (rs <= rt) signed PC += off

1001 (0x9): Jump Instructions

Mnemonic Description
J addr PC = addr

1010 (0xA): Jump Register

Mnemonic Description
JR rs PC = R[rs]

1011 (0xB): Load Word

Mnemonic Description
LW rd,base,off rd = Mem[base + off]

1100 (0xC): Store Word

Mnemonic Description
SW rs,base,off Mem[base + off] = rs

(0xD–0xF reserved for future extensions.)

Instruction Formats

R-Type (Arithmetic/Shift/Logical)

| opcode (4b) | rd (3b) | rs (3b) | rt (3b) | funct (3b) |

  • bits[15..12]: opcode
  • bits[11..9]: rd (destination register)
  • bits[8..6]: rs (source register)
  • bits[5..3]: rt (source register)
  • bits[2..0]: funct (specific operation)

I-Type (Load Immediate)

| opcode (4b) | rd (3b) | imm (9b) |

  • bits[15..12]: opcode
  • bits[11..9]: rd (destination register)
  • bits[8..0]: imm (9-bit immediate)

Branch

| opcode (4b) | rs (3b) | rt (3b) | offset (6b) |

  • bits[15..12]: opcode
  • bits[11..9]: rs (register tested)
  • bits[8..6]: rt (comparison register)
  • bits[5..0]: offset (6-bit signed offset)

Jump (J)

| opcode (4b) | addr (12b) |

  • bits[15..12]: opcode
  • bits[11..0]: addr (12-bit address)

Jump Register (JR)

| opcode (4b) | rs (3b) | unused (9b) |

  • bits[15..12]: opcode
  • bits[11..9]: rs (register containing target address)
  • bits[8..0]: unused = 0

Load/Store

| opcode (4b) | rd/rs (3b) | base (3b) | offset (6b) |

  • bits[15..12]: opcode
  • bits[11..9]: For LW: rd (destination), For SW: rs (source)
  • bits[8..6]: base (base register)
  • bits[5..0]: offset (6-bit signed offset)

Summary

  • 0000 (0x0) + funct: Arithmetic & Shift Instructions
  • 0001 (0x1) + funct: Logical Instructions
  • 0010 (0x2): LIL (Load Immediate Low)
  • 0011 (0x3): LIU (Load Immediate Upper)
  • 0100–1000 (0x4–0x8): Branch Instructions
  • 1001 (0x9): Jump
  • 1010 (0xA): Jump Register
  • 1011 (0xB): Load Word
  • 1100 (0xC): Store Word
  • 1101–1111 (0xD–0xF): Reserved for future extensions.
Raw
1_Assembler.py
import sys
def assemble(instructions):
REGISTERS = {
"R0": 0, "R1": 1, "R2": 2, "R3": 3,
"R4": 4, "R5": 5, "R6": 6, "R7": 7
}
OPCODES = {
"ADD": 0x0, "SUB": 0x0, "AND": 0x0, "OR": 0x0, "XOR": 0x0,
"SRA": 0x0, "SLL": 0x0, "SRL": 0x0, "LIL": 0x2, "LIU": 0x3,
"BEQ": 0x4, "BLTU": 0x5, "BLTS": 0x6, "BLTEU": 0x7, "BLTES": 0x8,
"J": 0x9, "JR": 0xA, "LW": 0xB, "SW": 0xC
}
FUNCT_CODES = {
"ADD": 0b000, "SUB": 0b001, "AND": 0b010, "OR": 0b011,
"XOR": 0b100, "SRA": 0b101, "SLL": 0b110, "SRL": 0b111
}
assembled = []
for line in instructions.splitlines():
line = line.split("#")[0].strip() # Remove comments
if not line:
continue
parts = line.replace(',', ' ').split()
mnemonic = parts[0].upper()
if mnemonic in ["ADD", "SUB", "AND", "OR", "XOR", "SRA", "SLL", "SRL"]:
rd = REGISTERS[parts[1]]
rs = REGISTERS[parts[2]]
rt = REGISTERS[parts[3]]
funct = FUNCT_CODES[mnemonic]
opcode = OPCODES[mnemonic]
instr = (opcode << 12) | (rd << 9) | (rs << 6) | (rt << 3) | funct
elif mnemonic in ["LIL", "LIU"]:
rd = REGISTERS[parts[1]]
imm = int(parts[2]) & 0x1FF
opcode = OPCODES[mnemonic]
instr = (opcode << 12) | (rd << 9) | imm
elif mnemonic in ["BEQ", "BLTU", "BLTS", "BLTEU", "BLTES"]:
rs = REGISTERS[parts[1]]
rt = REGISTERS[parts[2]]
offset = int(parts[3]) & 0x3F
opcode = OPCODES[mnemonic]
instr = (opcode << 12) | (rs << 9) | (rt << 6) | offset
elif mnemonic == "J":
addr = int(parts[1]) & 0xFFF
opcode = OPCODES[mnemonic]
instr = (opcode << 12) | addr
elif mnemonic == "JR":
rs = REGISTERS[parts[1]]
opcode = OPCODES[mnemonic]
instr = (opcode << 12) | (rs << 9)
elif mnemonic in ["LW", "SW"]:
rd_rs = REGISTERS[parts[1]]
base = REGISTERS[parts[2]]
offset = int(parts[3]) & 0x3F
opcode = OPCODES[mnemonic]
instr = (opcode << 12) | (rd_rs << 9) | (base << 6) | offset
else:
print(f"Unknown mnemonic: {mnemonic}")
continue
# Convert to little endian
instr_bytes = instr.to_bytes(2, byteorder='little')
assembled.append(instr_bytes.hex())
return assembled
# Example input
assembly_code = """
LIL R1, 15 # Load Immediate Low
LIU R2, 8 # Load Immediate Upper
ADD R3, R1, R2 # R3 = R1 + R2
BEQ R3, R0, 4 # Branch if Equal
J 1024 # Jump to address 1024
LW R4, R1, 2 # Load Word
SW R4, R1, 2 # Store Word
JR R2 # Jump Register
"""
if __name__ == "__main__":
machine_code = assemble(assembly_code)
print("Assembled Machine Code (Little Endian Hex):")
for instr in machine_code:
print(instr)
Raw
2_CPU.circ
<?xml version="1.0" encoding="UTF-8" standalone="no"?>
<project source="3.9.0" version="1.0">
This file is intended to be loaded by Logisim-evolution v3.9.0(https://github.com/logisim-evolution/).
<lib desc="#Wiring" name="0">
<tool name="Pin">
<a name="appearance" val="classic"/>
</tool>
</lib>
<lib desc="#Gates" name="1"/>
<lib desc="#Plexers" name="2"/>
<lib desc="#Arithmetic" name="3"/>
<lib desc="#Memory" name="4"/>
<lib desc="#I/O" name="5"/>
<lib desc="#TTL" name="6"/>
<lib desc="#TCL" name="7"/>
<lib desc="#Base" name="8"/>
<lib desc="#BFH-Praktika" name="9"/>
<lib desc="#Input/Output-Extra" name="10"/>
<lib desc="#Soc" name="11"/>
<main name="ALU"/>
<options>
<a name="gateUndefined" val="ignore"/>
<a name="simlimit" val="1000"/>
<a name="simrand" val="0"/>
</options>
<mappings>
<tool lib="8" map="Button2" name="Poke Tool"/>
<tool lib="8" map="Button3" name="Menu Tool"/>
<tool lib="8" map="Ctrl Button1" name="Menu Tool"/>
</mappings>
<toolbar>
<tool lib="8" name="Poke Tool"/>
<tool lib="8" name="Edit Tool"/>
<tool lib="8" name="Wiring Tool"/>
<tool lib="8" name="Text Tool"/>
<sep/>
<tool lib="0" name="Pin"/>
<tool lib="0" name="Pin">
<a name="facing" val="west"/>
<a name="output" val="true"/>
</tool>
<sep/>
<tool lib="1" name="NOT Gate"/>
<tool lib="1" name="AND Gate"/>
<tool lib="1" name="OR Gate"/>
<tool lib="1" name="XOR Gate"/>
<tool lib="1" name="NAND Gate"/>
<tool lib="1" name="NOR Gate"/>
<sep/>
<tool lib="4" name="D Flip-Flop"/>
<tool lib="4" name="Register"/>
</toolbar>
<circuit name="main">
<a name="appearance" val="logisim_evolution"/>
<a name="circuit" val="main"/>
<a name="circuitnamedboxfixedsize" val="true"/>
<a name="simulationFrequency" val="1.0"/>
<comp lib="0" loc="(1000,1360)" name="Tunnel">
<a name="label" val="opcode"/>
<a name="width" val="4"/>
</comp>
<comp lib="0" loc="(1010,330)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="Clk"/>
</comp>
<comp lib="0" loc="(1020,160)" name="Probe">
<a name="appearance" val="NewPins"/>
<a name="radix" val="16"/>
</comp>
<comp lib="0" loc="(1030,1390)" name="Tunnel">
<a name="label" val="R_X"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1030,1420)" name="Tunnel">
<a name="label" val="R_Y"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1040,1080)" name="Tunnel">
<a name="label" val="R_X"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1040,1110)" name="Tunnel">
<a name="label" val="R_Y"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1040,1140)" name="Tunnel">
<a name="label" val="R_Z"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1040,1520)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="BranchOffset"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="6"/>
</comp>
<comp lib="0" loc="(1040,430)" name="Tunnel">
<a name="label" val="Instruction"/>
<a name="width" val="16"/>
</comp>
<comp lib="0" loc="(1050,760)" name="Tunnel">
<a name="label" val="LoadImmLower"/>
</comp>
<comp lib="0" loc="(1050,790)" name="Tunnel">
<a name="label" val="LoadImmUpper"/>
</comp>
<comp lib="0" loc="(1060,1580)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="PC_Val"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="12"/>
</comp>
<comp lib="0" loc="(1070,730)" name="Tunnel">
<a name="label" val="AritmeticOp"/>
</comp>
<comp lib="0" loc="(1070,820)" name="Tunnel">
<a name="label" val="BranchEqual"/>
</comp>
<comp lib="0" loc="(1070,850)" name="Tunnel">
<a name="label" val="BranchLTUnsigned"/>
</comp>
<comp lib="0" loc="(1070,880)" name="Tunnel">
<a name="label" val="BranchLTSigned"/>
</comp>
<comp lib="0" loc="(1070,910)" name="Tunnel">
<a name="label" val="BranchLTEqUnsigned"/>
</comp>
<comp lib="0" loc="(1070,940)" name="Tunnel">
<a name="label" val="BranchLTEqSigned"/>
</comp>
<comp lib="0" loc="(1070,970)" name="Tunnel">
<a name="label" val="JumpOp"/>
</comp>
<comp lib="0" loc="(1090,1520)" name="Bit Extender">
<a name="in_width" val="6"/>
<a name="out_width" val="12"/>
</comp>
<comp lib="0" loc="(1160,1510)" name="Constant">
<a name="value" val="0x0"/>
</comp>
<comp lib="0" loc="(1210,340)" name="Probe">
<a name="appearance" val="NewPins"/>
<a name="radix" val="16"/>
</comp>
<comp lib="0" loc="(1220,1090)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="Instruction"/>
<a name="width" val="16"/>
</comp>
<comp lib="0" loc="(1240,1090)" name="Splitter">
<a name="bit0" val="2"/>
<a name="bit1" val="2"/>
<a name="bit10" val="1"/>
<a name="bit11" val="1"/>
<a name="bit12" val="0"/>
<a name="bit13" val="0"/>
<a name="bit14" val="0"/>
<a name="bit15" val="0"/>
<a name="bit3" val="2"/>
<a name="bit4" val="2"/>
<a name="bit5" val="2"/>
<a name="bit6" val="2"/>
<a name="bit7" val="2"/>
<a name="bit8" val="2"/>
<a name="bit9" val="1"/>
<a name="fanout" val="4"/>
<a name="incoming" val="16"/>
</comp>
<comp lib="0" loc="(1240,1560)" name="Tunnel">
<a name="label" val="BranchAddr"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="12"/>
</comp>
<comp lib="0" loc="(1280,1210)" name="Constant">
<a name="value" val="0x0"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1290,1160)" name="Constant">
<a name="value" val="0x0"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1310,1190)" name="Splitter">
<a name="bit0" val="1"/>
<a name="bit10" val="0"/>
<a name="bit11" val="0"/>
<a name="bit2" val="1"/>
<a name="bit3" val="0"/>
<a name="bit4" val="0"/>
<a name="bit5" val="0"/>
<a name="bit6" val="0"/>
<a name="bit7" val="0"/>
<a name="bit8" val="0"/>
<a name="bit9" val="0"/>
<a name="facing" val="west"/>
<a name="incoming" val="12"/>
</comp>
<comp lib="0" loc="(1320,1050)" name="Tunnel">
<a name="label" val="opcode"/>
<a name="width" val="4"/>
</comp>
<comp lib="0" loc="(1320,1140)" name="Splitter">
<a name="bit1" val="0"/>
<a name="bit10" val="1"/>
<a name="bit11" val="1"/>
<a name="bit2" val="0"/>
<a name="bit3" val="0"/>
<a name="bit4" val="0"/>
<a name="bit5" val="0"/>
<a name="bit6" val="0"/>
<a name="bit7" val="0"/>
<a name="bit8" val="0"/>
<a name="bit9" val="1"/>
<a name="facing" val="west"/>
<a name="incoming" val="12"/>
</comp>
<comp lib="0" loc="(1320,1140)" name="Tunnel">
<a name="label" val="ImmediateAsLower"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="12"/>
</comp>
<comp lib="0" loc="(1320,1190)" name="Tunnel">
<a name="label" val="ImmediateAsUpper"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="12"/>
</comp>
<comp lib="0" loc="(1350,1080)" name="Tunnel">
<a name="label" val="R_X"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(140,630)" name="Constant"/>
<comp lib="0" loc="(140,660)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="Clk"/>
</comp>
<comp lib="0" loc="(1560,1080)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="Instruction"/>
<a name="width" val="16"/>
</comp>
<comp lib="0" loc="(1570,170)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="RegWriteEnable"/>
</comp>
<comp lib="0" loc="(1570,200)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="RegOut0Select"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1570,230)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="RegOut1Select"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1580,1080)" name="Splitter">
<a name="bit0" val="1"/>
<a name="bit10" val="1"/>
<a name="bit11" val="1"/>
<a name="bit12" val="0"/>
<a name="bit13" val="0"/>
<a name="bit14" val="0"/>
<a name="bit15" val="0"/>
<a name="bit2" val="1"/>
<a name="bit3" val="1"/>
<a name="bit4" val="1"/>
<a name="bit5" val="1"/>
<a name="bit6" val="1"/>
<a name="bit7" val="1"/>
<a name="bit8" val="1"/>
<a name="bit9" val="1"/>
<a name="fanout" val="4"/>
<a name="incoming" val="16"/>
</comp>
<comp lib="0" loc="(1580,90)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="RegWriteVal"/>
<a name="width" val="12"/>
</comp>
<comp lib="0" loc="(1590,640)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="AritmeticOp"/>
</comp>
<comp lib="0" loc="(1590,770)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="S_decode"/>
</comp>
<comp lib="0" loc="(1600,130)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="RegWriteSelect"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1610,670)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="LoadImmLower"/>
</comp>
<comp lib="0" loc="(1610,700)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="LoadImmUpper"/>
</comp>
<comp lib="0" loc="(1620,510)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="R_X"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1650,1070)" name="Tunnel">
<a name="label" val="JumpAddr"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="12"/>
</comp>
<comp lib="0" loc="(1650,190)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="Clk"/>
</comp>
<comp lib="0" loc="(1670,1040)" name="Tunnel">
<a name="label" val="opcode"/>
<a name="width" val="4"/>
</comp>
<comp lib="0" loc="(1730,1160)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="R_Y"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1730,1190)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="R_Z"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1730,1230)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="R_X"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1730,1260)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="R_Y"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1750,480)" name="Probe">
<a name="appearance" val="NewPins"/>
</comp>
<comp lib="0" loc="(1780,1160)" name="Splitter">
<a name="bit1" val="0"/>
<a name="bit2" val="0"/>
<a name="bit3" val="1"/>
<a name="bit4" val="1"/>
<a name="bit5" val="1"/>
<a name="facing" val="west"/>
<a name="incoming" val="6"/>
</comp>
<comp lib="0" loc="(1780,1230)" name="Splitter">
<a name="bit1" val="0"/>
<a name="bit2" val="0"/>
<a name="bit3" val="1"/>
<a name="bit4" val="1"/>
<a name="bit5" val="1"/>
<a name="facing" val="west"/>
<a name="incoming" val="6"/>
</comp>
<comp lib="0" loc="(1780,530)" name="Tunnel">
<a name="label" val="RegWriteSelect"/>
<a name="width" val="3"/>
</comp>
<comp lib="0" loc="(1790,700)" name="Tunnel">
<a name="label" val="RegWriteEnable"/>
</comp>
<comp lib="0" loc="(1850,1390)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="AritmeticOp"/>
</comp>
<comp lib="0" loc="(1850,1440)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="BranchInst"/>
</comp>
<comp lib="0" loc="(1850,1520)" name="Tunnel">
<a name="facing" val="east"/>
<a name="label" val="S_decode"/>
</comp>
<comp lib="0" loc="(1970,40)" name="Tunnel">
<a name="label" val="RegOut0"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="12"/>
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<comp lib="0" loc="(1970,70)" name="Tunnel">
<a name="label" val="RegOut1"/>
<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="12"/>
</comp>
<comp lib="0" loc="(1990,880)" name="Tunnel">
<a name="facing" val="east"/>
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<comp lib="0" loc="(1990,910)" name="Tunnel">
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<a name="bit2" val="0"/>
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<comp lib="0" loc="(2050,480)" name="Tunnel">
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<comp lib="0" loc="(2060,810)" name="Tunnel">
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<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="12"/>
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<comp lib="0" loc="(2060,840)" name="Tunnel">
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<a name="labelfont" val="Monospaced bold 16"/>
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<comp lib="0" loc="(2910,930)" name="Tunnel">
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<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="12"/>
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<comp lib="0" loc="(2930,990)" name="Tunnel">
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<a name="labelfont" val="Monospaced bold 16"/>
<a name="width" val="12"/>
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<comp lib="0" loc="(3140,1340)" name="Tunnel">
<a name="label" val="PC_WE"/>
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<comp lib="0" loc="(330,190)" name="Tunnel">
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<a name="labelfont" val="Monospaced bold 16"/>
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<comp lib="0" loc="(820,210)" name="Tunnel">
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<comp lib="0" loc="(830,1050)" name="Probe">
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<comp lib="2" loc="(1980,1280)" name="Multiplexer">
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<a name="width" val="6"/>
</comp>
<comp lib="2" loc="(1980,1440)" name="Priority Encoder">
<a name="select" val="2"/>
</comp>
<comp lib="2" loc="(2220,530)" name="Multiplexer">
<a name="select" val="2"/>
<a name="width" val="12"/>
</comp>
<comp lib="2" loc="(2430,990)" name="Priority Encoder"/>
<comp lib="2" loc="(2520,840)" name="Multiplexer">
<a name="enable" val="true"/>
<a name="select" val="3"/>
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<comp lib="2" loc="(2740,1240)" name="Multiplexer">
<a name="select" val="2"/>
<a name="width" val="12"/>
</comp>
<comp lib="2" loc="(2740,1400)" name="Priority Encoder">
<a name="select" val="2"/>
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<comp lib="2" loc="(3040,1230)" name="Multiplexer">
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<comp lib="2" loc="(330,600)" name="Decoder">
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<a name="select" val="3"/>
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<comp lib="2" loc="(400,200)" name="Multiplexer">
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</comp>
<comp lib="2" loc="(910,760)" name="Decoder">
<a name="enable" val="false"/>
<a name="select" val="4"/>
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</comp>
<comp lib="3" loc="(1200,1560)" name="Adder">
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</comp>
<comp lib="4" loc="(170,580)" name="Register">
<a name="appearance" val="logisim_evolution"/>
<a name="label" val="State"/>
<a name="width" val="3"/>
</comp>
<comp lib="4" loc="(2940,920)" name="Register">
<a name="appearance" val="logisim_evolution"/>
<a name="label" val="PC"/>
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</comp>
<comp lib="4" loc="(500,200)" name="RAM">
<a name="addrWidth" val="12"/>
<a name="appearance" val="logisim_evolution"/>
<a name="label" val="MyRam"/>
</comp>
<comp lib="4" loc="(840,140)" name="Register">
<a name="appearance" val="logisim_evolution"/>
</comp>
<comp lib="8" loc="(1167,58)" name="Text">
<a name="font" val="SansSerif bold 23"/>
<a name="text" val="Load, load Imm, Sign??"/>
</comp>
<comp lib="8" loc="(1255,1025)" name="Text">
<a name="font" val="SansSerif bold 25"/>
<a name="text" val="I-Type"/>
</comp>
<comp lib="8" loc="(1635,1015)" name="Text">
<a name="font" val="SansSerif bold 25"/>
<a name="text" val="Jump Format"/>
</comp>
<comp lib="8" loc="(895,1020)" name="Text">
<a name="font" val="SansSerif bold 25"/>
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</comp>
<comp lib="8" loc="(961,1318)" name="Text">
<a name="font" val="SansSerif bold 25"/>
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</comp>
<comp loc="(1890,130)" name="RegBlock"/>
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<text dominant-baseline="central" font-family="SansSerif" font-size="10" text-anchor="middle" x="253" y="59">+1</text>
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<comp lib="2" loc="(1470,420)" name="Decoder">
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<comp lib="2" loc="(2420,80)" name="Multiplexer">
<a name="select" val="3"/>
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<a name="label" val="R4"/>
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<comp lib="4" loc="(1790,140)" name="Register">
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<a name="label" val="R1"/>
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</comp>
<comp lib="4" loc="(1790,280)" name="Register">
<a name="appearance" val="logisim_evolution"/>
<a name="label" val="R5"/>
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<comp lib="4" loc="(1900,140)" name="Register">
<a name="appearance" val="logisim_evolution"/>
<a name="label" val="R2"/>
<a name="labelloc" val="south"/>
<a name="width" val="12"/>
</comp>
<comp lib="4" loc="(1900,280)" name="Register">
<a name="appearance" val="logisim_evolution"/>
<a name="label" val="R6"/>
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<comp lib="4" loc="(2010,140)" name="Register">
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<comp lib="4" loc="(2010,280)" name="Register">
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